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宜科伺服電機(jī)編碼器的配線要求

①配線應(yīng)在電源OFF狀態(tài)下進(jìn)行,電源接通時(shí),若輸出線接觸電源,則有時(shí)會損壞輸出回路。


②若配線過錯(cuò),則有時(shí)會損壞內(nèi)部回路,所以配線時(shí)應(yīng)充分注意電源的極性等。


③若和高壓線、動力線并行配線,則有時(shí)會遭到感應(yīng)造成誤動作而損壞,所以要分離開另行配線。


④延伸電線時(shí),應(yīng)在10m以下。而且因?yàn)殡娋€的分布容量,波形的上升、下降時(shí)間會較長,有問題時(shí),采用施密特回路等對波形進(jìn)行整形。


⑤為了防止感應(yīng)噪聲等,要盡量用zui短距離配線。向集成電路輸入時(shí),特別需求注意。


⑥電線延伸時(shí),因?qū)w電阻及線間電容的影響,波形的上升、下降時(shí)間加長,簡單產(chǎn)生信號間的攪擾(串音),因此使用電阻小、線間電容低的電線(雙絞線、屏蔽線)。

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